公交車自動報站系統(tǒng)畢業(yè)論文外文翻譯1

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1、英文翻譯原文 The bus stops system automatically 1. The bus is automatically stops the background and significance The people of car out for provides convenient service, while the bus stops directly affect the quality of the service. Traditional stops by the crew artificially, and in this way because o

2、f its poor and working intensity effect is too great, in many big cities have been eliminated. In recent years, with the development of science and technology progress and microcomputer technology in many fields has been widely used. In the acoustic field, with various pronunciation chip microcomput

3、er technology, can complete combined speech synthesis technology, makes the car stops controller is realized for citizens becomes possible, and thus provide a more personalized service. In view of the traditional bus stops system deficiency, combined with the use of public transport vehicle characte

4、ristics and practical operating environment, the design of a single-chip microcomputer control bus stops system automatically. The bus stops the design of automatic device is mainly to compensate for changing the traditional voice stops device must have driver control can work backward way, pitted

5、, automatic station broadcasts six-foot-tall service term for the public and provide more humanized more perfect service. 2. The system design of each component This system is designed hardware circuit design part: use AT89C51 as controller, through ISD4004 pronunciation chip establish speech, f

6、orming a variety of information and use the voice messages broadcast speech information and tips amplifier, and using speech, LED digital display for standing count. When the bus arrived at one site, use the keyboard control the system work, through the yukon voice circuits output speech information

7、 and tips, stood in several information LED digital tube display. The whole system hardware design including keyboard circuit and reset circuit, display driver circuit, display circuit, memory expansion circuit module. In order to realize the bus stops, namely in speech automatic six-foot-tall; an

8、d when voice prompt information and automatic reporting service term, while utilizing of LED dot matrix circuit Chinese displaying. This design is required to exploit the AT89C51 as the master control circuit design of chips, auxiliary circuit requirements including voice circuits, Chinese dot matri

9、x display circuit, the power supply circuit, etc. The CPU control and control signals, pronunciation chip, output indicator light component. The bus station is automatically stops the car wheel design, to count the pulse Angle, will count value compared with preset value, can determine moments, atta

10、in the precise automatically stops the purpose. USES AT89C51 as main control chip, combining to foreign pulse count ISD4004 output voice pronunciation chip. System consists of pulse detection, pulse count, CPU control and control signals, pronunciation chip, output indicator light component. About

11、 AT89C51 chip: AT89C51 it mainly consists of for the following parts: 1 eight central processing unit (CPU), piece you in memory, the pieces (Flash RAM, 4 of 8 bits two-way addressable I/O port, 1 full-duplex UART (general asynchronous receiver transmitter) serial interface, 2 16 timer/counters, m

12、ultiple priority nested interrupt structure, and a piece inside oscillator and clock circuit. In AT89C51 structure, the most striking characteristics of internal contains Flash memory is, while in other aspects of the structure of the Intel corporation, the and the structure of the 8051 no much diff

13、erence. Main performance: 1. With MCS - 51 compatible 2. 4K bytes programmable flashing memory Life expectancy: 1000 times to write/wipe cycle Data retention time: 10 years 3. All the static job: 0Hz - 24Hz 4. Tertiary program memory lock 5. 128 * 8 bits inside 6. 32 programmable I

14、/O lines 7. Two 16 timers, counter 8. Five interrupt source 9. Programmable serial channels 10. Slice clock circuit oscillator and within The design of pulse detection circuit: The design of the key is that the rotor turn lap count, considering the vehicles will be running in a complex e

15、nvironment, and the hall componets are resistant to vibrate, afraid of dust, grease, water vapor and salt fog the advantages of the pollution or corrosion, so adopt reliable hall element DN6848 as signal acquisition device, again by photoelectric couplers 4N25 input to microcontroller. Photoelectric

16、 coupler current transmission 10% ~ 25%, than for less than 10us response time. About speech output circuit design This series of chip required by the microprocessor or micro controller series through serial peripheral interfaces and serial interface addressing and control. The recording data is

17、 stored method of multistage storage is through ISD patent technology implementation, with sound and audio signals directly in the natural form of solid state memory, thus providing high quality replay the fidelity of speech. ISD4004 voice recording devices for 6.4 kHZ sampling frequency, time and

18、 recording a single chip 8 points, 10 points, 12 points, 16 points several, and its use of built-in FLASH memory cost nonvolatile CaXie memory, this fast data, and it is not lost power save data department needs power consumption. The typical stored information can save time up to 100 years, the sam

19、e storage unit can be repeated be recorded 10 million times. IAD4004 chip audio output pin can drive a five thousand uefa load, when device after power up, change the power output pins for 1.2 v. to this design of chosen amplifier is LM386 is for low voltage application design audio amplifier, the

20、 working voltage of 6V, maximum distortion degree of 0.2, power frequency response to 20 ~ 100 KHZ About LED display output design: This circuit USES 16 * 256 destem to display 16 16 * 16 Chinese characters, using the video memory U14 to deposit the characters bitmap information. Screen points p

21、age 32, each page 16 line 8 column LED by constitute the light emitting diode, destem with a four - 16 decoder 74LS154 decode, will address A0 - A3 decode formed by two do signal, 4-16 decoder 74LS154 form a 5-32 decoder, carries on the page decode, will address A4 - A8 decode form page, choose comm

22、unication, respectively, to choose a 74LS244 general 74LS244 data through this system to a page in a line of eight leds into display information. 3. The characteristics of the system and advantage This system greatly improve the accuracy of bus stops, and reliability. Improving the service quali

23、ty of the bus system. Promote the city economic development and harmonious development of traffic changes. Made up for changing the traditional voice stops device must have driver control can work means, in the bus stops behind when the station broadcasts, automatic six-foot-tall service term for th

24、e public and provide more humanized more perfect service. 英文譯文 公交車自動報站系統(tǒng) 1. 公交車自動報站器的背景及意義 共汽車為外出的人們提供了方便快捷的服務(wù)，而公共汽車的報站直接影響服務(wù)的質(zhì)量。傳統(tǒng)由乘務(wù)人員人工報站，這種方式因其效果太差和工作強度太大，在很多大城市已經(jīng)被淘汰。近年來，隨著科學(xué)技術(shù)的日益發(fā)展和進(jìn)步，微型計算機技術(shù)已經(jīng)在許多領(lǐng)域得到了廣泛的應(yīng)用。在聲學(xué)領(lǐng)域，微機技術(shù)與各種語音芯片相結(jié)合，即可完成語音的合成技術(shù)，使得汽車報站器的實現(xiàn)成為可能，從而為市民提供了更加人性化的服務(wù)。鑒于傳統(tǒng)公交車報站系統(tǒng)的不足之

25、處，結(jié)合公交車輛的使用特點及實際營運環(huán)境，設(shè)計了一種由單片機控制的公交車自動報站系統(tǒng)。 公交車自動報站器的設(shè)計主要是為了彌補改變傳統(tǒng)語音報站器必須有司機操控才能工作的落后方式，進(jìn)站、出站自動播報站名及服務(wù)用語，為市民提供更人性化更完善的服務(wù)。 2. 系統(tǒng)各組成部分的設(shè)計 本系統(tǒng)設(shè)計主要是硬件電路設(shè)計部分：利用AT89C51作為控制器，通過ISD4004語音芯片建立語音信息庫，形成變化多樣的語音信息，利用其功放播放語音信息以及提示語音，，同時運用LED數(shù)碼進(jìn)行站數(shù)顯示。當(dāng)公交車到達(dá)某站點，用鍵盤控制本系統(tǒng)工作，通過育語音電路輸出語音信息和提示，同時站數(shù)信息在LED數(shù)碼管上顯示。整個系統(tǒng)硬件

26、設(shè)計包括鍵盤電路、復(fù)位電路、顯示驅(qū)動電路、顯示電路、內(nèi)存擴展電路模塊。 為了 實現(xiàn)公交車的語音自動報站，即在進(jìn)站、出站時候自動播報語音提示信息及服務(wù)用語，同時利用LED點陣電路進(jìn)行漢字顯示。本設(shè)計要求利用AT89C51作為主控芯片完成主控電路的設(shè)計，輔助電路要求包括語音電路、漢字點陣顯示電路、電源電路等。CPU控制、控制信號、語音芯片、輸出顯示燈組成。公交車站自動報站器的設(shè)計，對車輪軸的轉(zhuǎn)角的脈沖進(jìn)行計數(shù)，將計數(shù)值與預(yù)置值對比，即可確定報站時刻，達(dá)到準(zhǔn)確自動的目的。以AT89C51為主控芯片，對外來脈沖計數(shù)，結(jié)合語音芯片ISD4004輸出語音。系統(tǒng)由脈沖檢測、脈沖計數(shù)、CPU控制、控制信號、

27、語音芯片、輸出顯示燈組成。 關(guān)于AT89C51芯片： AT89C51單片機它主要由下面幾個部分組成：1個8位中央處理單元你（CPU）、片內(nèi)Flash存儲器，片內(nèi)RAM、4個8位的雙向可尋址I/O口、1個全雙工UART（通用異步接收發(fā)送器）的串行接口、2個16位的定時器/計數(shù)器、多個優(yōu)先級的嵌套中斷結(jié)構(gòu)，以及一個片內(nèi)振蕩器和時鐘電路。在AT89C51單片機結(jié)構(gòu)中，最顯著的特點是內(nèi)部含有Flash存儲器，而在其他方面的結(jié)構(gòu)，則和Intel公司的8051的結(jié)構(gòu)沒有太大的區(qū)別。 主要性能： 1. 與MCS-51兼容 2. K字節(jié)可編程閃爍存儲器 壽命：1000次寫/擦循環(huán) 數(shù)據(jù)保留

28、時間：10年 3. 全靜態(tài)工作：0Hz-24Hz 4. 三級程序存儲器鎖定 5. 128*8位內(nèi)部 6. 32可編程I/O線 7. 兩個16位定時器、計數(shù)器 8. 5個中斷源 9. 可編程串行通道 10. 片內(nèi)振蕩器和時鐘電路 關(guān)于脈沖檢測電路的設(shè)計： 本設(shè)計的關(guān)鍵是對轉(zhuǎn)軸所轉(zhuǎn)過的圈數(shù)進(jìn)行計數(shù)，考慮到車輛將在復(fù)雜的環(huán)境中運行，而霍爾元件具有耐震動，不怕灰塵、油污、水汽及鹽霧等的污染或腐蝕的優(yōu)點，故采用可靠的霍爾元件DN6848作為信號采集裝置，再經(jīng)過光電耦合器4N25輸入給單片機。光電耦合器的電流傳輸比為10%~25%，響應(yīng)時間小于10us。 關(guān)于語音輸出電路設(shè)計 這個

29、系列的芯片要求由于微處理器或微控制器系列通過串行外圍接口和串行接口進(jìn)行尋址和控制。錄音數(shù)據(jù)被存放方法是通過ISD的多級存儲專利技術(shù)實現(xiàn)的，用聲音和聲頻信號的自然形式直接存放在固態(tài)存儲器中，從而提供高質(zhì)量回放語音的保真度。 ISD4004聲音錄放器件的采樣頻率為6.4kHZ,它單片錄放時間又8分、10分、12分、16分幾種，其采用內(nèi)置費易失性FLASH存儲器，這種快擦寫存儲器斷電不會丟失數(shù)據(jù)，所以保存數(shù)據(jù)部需要耗電。典型的被存儲信息可以保存時間高達(dá)100年，同一個存儲單元可以反復(fù)被錄音10萬次。 IAD4004芯片的音頻輸出引腳可以驅(qū)動一個5千歐的負(fù)載，當(dāng)器件上電后，改引腳輸出的電源為1.

30、2v.本設(shè)計中選用的放大器是LM386是為低電壓應(yīng)用設(shè)計的 音頻功率放大器，其工作電壓為6V，最大失真度為0.2，功率頻響為20~100KHZ 關(guān)于LED顯示輸出設(shè)計： 本電路采用16*256的LED點陣顯示屏來顯示16個16*16的漢字，采用顯存U14來存放漢字點陣信息。顯示屏分32頁，每頁由16行8列LED發(fā)光二極管構(gòu)成，在LED點陣顯示屏中，用一片4-16譯碼器74LS154進(jìn)行譯碼，將地址A0-A3譯碼形成行信號，用兩片4-16譯碼器74LS154組成一個5-32譯碼器，進(jìn)行頁譯碼，將地址A4-A8譯碼形成頁選通信號，分別用以選通一片74LS244，系統(tǒng)通過此74LS244的數(shù)據(jù)

31、線向該頁的某行上的8個發(fā)光二極管送入顯示信息。 3.系統(tǒng)的特點和優(yōu)勢 本系統(tǒng)很大程度上提高公交車報站的準(zhǔn)確性，可靠性。提高了公交系統(tǒng)的服務(wù)質(zhì)量。促進(jìn)城市經(jīng)濟發(fā)展和交通變化的和諧發(fā)展。彌補了改變傳統(tǒng)語音報站器必須有司機操控才能工作的落后方式，在公交車進(jìn)站、出站時自動播報站名及服務(wù)用語，為市民提供更人性化更完善的服務(wù)。 總體描述 帶有隨機存儲器的DS12887實時時鐘芯片完全可以代替DS1287。DS12887在外型，性能和功能都和DS1287是完全一樣的，而且?guī)в幸粋€64字節(jié)的隨機存儲器。當(dāng)?shù)刂范丝谠试S輸入時是否進(jìn)入隨機存儲器是由加在AD6S上的邏輯電平?jīng)Q定。一個鋰能源，石英晶振和寫保護

32、電路被包含在一個24 針的雙列直插的封裝里。同樣地， DS12887 是一個能完全代替16個元件的典型應(yīng)用的完全子系統(tǒng)。它的功能包括一個不容易變的帶有日歷的時鐘，一個報警器，一個 100 年的日歷，可編程中斷，正方形波產(chǎn)生器和 114個位元組的 NV SRAM 。 RTC 是很獨特的，因為時鐘和存儲在掉電的情況下仍然保持。 掉電和上電 RTC具有繼續(xù)操作的功能，而且所有的隨機存取儲存器, 時鐘,日歷和報警記錄位置會保持不變不管 VCC 輸入的電平。當(dāng) VCC 被適用于 DS12887 并且到達(dá)一個電平比 4.25 V 大的時候,倘若震蕩器正在運行，而且震蕩器倒數(shù)計時鏈不在重新設(shè)定狀態(tài)，裝置

33、在 200 ms 之后變成可讀寫了。在電源被應(yīng)用之后，這期間允許系統(tǒng)穩(wěn)定。當(dāng) VCC降低到4.25 V 的時候,不管片選輸入端為何值片選輸入被強迫到一個不變的電平。因此DS12887 是寫保護的。當(dāng) DS12887 在寫保護狀態(tài)時,所有的輸入都會被忽略，而且所有的輸出都處于高阻狀態(tài)。當(dāng) VCC降到大約 3 V 的一個的時候,外部的 VCC 補給被切斷，而且一個內(nèi)在的鋰電池來源提供電能給RTC和隨機存取儲存器記憶。 信號描述 直流的地和VCC就是在這些管腳上提供給該裝置的。VCC 是+5V輸入。當(dāng)5V被應(yīng)用在常態(tài)極限的時候, 裝置完全可進(jìn)入的而且數(shù)據(jù)能被寫和讀。當(dāng) VCC低于4.25V時，讀

34、、寫會被禁止。當(dāng)VCC降到3V的時候隨機存取儲存器和工作時間記錄被切換到內(nèi)部的鋰電池來供電。時間記錄功能在+25-C的時候不管VCC引腳的電平都能準(zhǔn)確到每月一分鐘。 MOT（總線模式選擇） MOT引腳提供了兩種總線類型的選擇，當(dāng)連接到 VCC時, 選擇摩托羅拉總線時序。當(dāng)連接到接地或不接時,選擇英代爾總線時序。該引腳大約有20 k 的內(nèi)阻。 SQW(正方形波輸出) SQW引腳能輸出一個信號，它是由RTC內(nèi)部15級分頻器中13個抽頭之一提供的，該引腳的頻率能用可編程的寄存器一來改變，SQW引腳的信號開關(guān)能由積存器二里的SQWE來控制，當(dāng)VCC電壓低于4.25V時SQW引腳的不可用。 A

35、D0 – AD7(雙向地址/數(shù)據(jù)復(fù)用總線) 總線復(fù)用能節(jié)約引腳因為地址和數(shù)據(jù)時分服用同一條總線。地址占用的第一部分和數(shù)據(jù)占用循環(huán)期間周期的第二部分的。地址/數(shù)據(jù)不會減慢讀取速度因為總線從地址到數(shù)據(jù)的轉(zhuǎn)換發(fā)生在內(nèi)部隨即存取器的讀取期間。作為地址總線使用時必須在地址輸入有效時讓ALE發(fā)生負(fù)跳變以所存AD0 到 AD6的地址。作為數(shù)據(jù)線使用時必須在DS或WR有脈沖來時才有效。在讀取中時在DS或RD脈膊的后部分循環(huán)期間DS12887會輸出8bit的數(shù)據(jù)。在總線處于英代爾時序的情況下RD變低或者在摩托羅拉時序的情況下DS變的高時，讀周期被結(jié)束，總線處于高阻狀態(tài)。 AS（地址鎖存） 用于控制復(fù)用總線

36、的地址鎖存輸入端，AS/ALE的下降沿鎖存地址到DS12887里。不管片選是否選中，在下一個上升沿時清除地址，讀取指令應(yīng)該被成對送出。 DS（數(shù)據(jù)選通信號） 該引腳有兩種操作模式，它主要就是處決于MOT的電平，當(dāng) MOT被連接到 VCC 的時候,摩托羅拉總線時序被選擇。在這一個模態(tài)中，DS在總線周期的后部分DS表現(xiàn)為一個正脈沖，被稱為數(shù)據(jù)復(fù)用。在讀周期,DS為一個DS12887 驅(qū)動的雙向總線。在寫周期DS的反跳變沿導(dǎo)致 DS12887 鎖存輸入的數(shù)據(jù)。當(dāng) MOT接地時,英代爾時序被選擇。在這一個模態(tài)中 DS被叫做讀( RD)。RD識別時序當(dāng)DS12887讀取數(shù)據(jù)總線時期。RD信號是如同輸

37、出準(zhǔn)許端(OE) 信號。 R/ W(讀/ 寫輸入) R/ W引腳也有二個操作的模態(tài)。當(dāng) MOT 接到 VCC 的時候為摩托羅拉時序, R/ W的電平標(biāo)識當(dāng)前周期是讀還是寫。當(dāng)DS是高的時候，R/ W 也是高電平時候表示讀周期。當(dāng) R/ W 在 DS 期間是低的時候為寫周期。當(dāng)MOT接地為英代爾時序時,R/ W信號是被稱為 WR。在這一個模態(tài)中，R/ W有那相同的意義當(dāng)做寫準(zhǔn)許在隨機存取儲存器上的信號。 （中斷請求輸出） 是一個DS12887低電平有效的輸出端，它能作為處理器的輸入，當(dāng)中斷狀態(tài)位和對應(yīng)的中斷允許位有效時，的輸出保持為低。復(fù)位和讀取C寄存器都可以清除的中斷信號。沒有中斷時

38、，呈現(xiàn)為高阻狀態(tài)，其他中斷源還可以掛接到中斷總線上。由于是漏極輸出，所以需要外接上拉電阻。 RESET（復(fù)位端） 復(fù)位腳對時鐘、日歷、RAM無效。復(fù)位引腳保持為低電平能補償電源的穩(wěn)定性，復(fù)位腳低電平時間取決于申請。系統(tǒng)上電時復(fù)位腳要保持電平200ms以上DS12887才能正常工作。當(dāng)復(fù)位腳為低并且Vcc高于4.25時發(fā)生以下情況 A.周期中斷允許（PEI）位清0。 B.鬧鐘中斷允許（ALE）位清0。 C.更新完成中斷標(biāo)志（UF）位清0。 D.中斷請求狀態(tài)標(biāo)志（IRQF）位清0。 E.周期中斷標(biāo)志（PF）位清0。 F.周期RESET為低時DS12887不可操作。 G.鬧鐘中斷標(biāo)

39、志（AF）位清0。 H. 呈現(xiàn)高阻狀態(tài)。 I.方波輸出允許（SQWE）位清0。 J.更新完成中斷允許（UIE）位清0。 通常情況下把RESET端和VCC連接在一起，這樣連接能使DS12887掉電和上電都不影響控制寄存器。 地址分布 DS12887所有地址包括114字節(jié)通用RAM、10字節(jié)用于記錄時間、日歷、鬧鐘的RAM以及4字節(jié)的控制、狀態(tài)RAM。所有字節(jié)都可以在除以下的情況下直接讀寫。 1. 寄存器C、D為只讀。 2. 寄存器A的第七位為只讀。 3. 秒字節(jié)的高位為只讀。 時間、日歷和鬧鐘位置 時間和日歷數(shù)據(jù)可以由讀適當(dāng)?shù)拇鎯ζ髯止?jié)獲得。時間，日歷和鬧鐘可以通過寫適當(dāng)?shù)?/p>

40、隨機存取儲存器位單元進(jìn)行設(shè)定或設(shè)定初值。這10個時間，日歷和鬧鐘位的內(nèi)容可能是二進(jìn)或(BCD)的格式。在寫內(nèi)部的時間，日歷和鬧鐘寄存器之前，寄存器B的SET應(yīng)該被寫成邏輯1來阻止更新的發(fā)生。 除了為挑選一個格式 ( 二進(jìn)位的或 BCD)寫10個時間，日歷和鬧鐘字節(jié)之外,寄存器B中的數(shù)據(jù)模態(tài)位(DM)也必須設(shè)置成適當(dāng)?shù)倪壿嬰娖?這10個字節(jié)必須用相同的模式。在數(shù)據(jù)模式位被設(shè)置并允許RTC更新時間和日歷之后必須清除寄存器中的SET位。一旦RTC被初始化，它在選擇模式方面做全面的更新。在沒有重新初始化的情況下數(shù)據(jù)模式是不會再改變。在沒有初始化小時位置的時候24-12位是不會改變的。當(dāng)選擇12小時制時

41、，當(dāng)high—order位為邏輯1是表示PM。時間、日歷和鬧鐘字節(jié)總是能被讀取因為被雙重緩沖。這些字節(jié)每一秒鐘都更新一次而且檢查鬧鐘字節(jié)。如果在更新時出現(xiàn)讀數(shù)據(jù)或者時分秒處出現(xiàn)問題時等等都可能無關(guān)。讀取時間和日歷數(shù)據(jù)錯誤的概率也是很低的。在稍后的文章中會講解一些避免任何的可能不正確的時間和日歷讀取的一些方法。 三個鬧鐘字節(jié)能被用成兩種方式。首先，當(dāng)在時、分、秒的位置上寫上鬧鈴時間，如果鬧鐘使能位為高電平時，鬧鐘就會在每天的準(zhǔn)點鬧鈴。第二種使用就是插入“don’t care”狀態(tài)到一個或多個鬧鐘字節(jié)中去，“don’t care”代碼是任何一個從C0到FF的值。為邏輯1時兩個最重要的為要都設(shè)成“

42、don’t care”，那么在每個小時都會鬧鈴，只要在這個時字節(jié)上設(shè)置“don’t care”。同樣可以在沒一分鐘都鬧鈴或在每一秒都鬧鈴。 非易失性RAM 114字節(jié)的非易失性通用RAM沒有特性功能，可以在任何時間進(jìn)行讀寫。 中斷 RTC的外加隨機存取儲存器包括三個分開, 完全自動中斷可用于處理器。鬧鐘中斷能被編程以從每一秒一次到每一天一次的波特率發(fā)生。周期的中斷能被選擇為從 500 ms到 122s波特率進(jìn)行發(fā)生。更新結(jié)束的中斷能用來指出一個更新完成。每一個這些中斷情況在本文其他的區(qū)段有詳細(xì)描述。 如果每一個都可用時，處理器能編程選擇任何一個中斷。寄存器B中有三個中斷使能位。如果

43、在中斷使能位寫邏輯1的話就允許中斷在觸發(fā)時間發(fā)生是進(jìn)行響應(yīng)。 如果中斷使能位為0時，就會使引腳無法判斷中斷的到來。如果開中斷時中斷標(biāo)志位被置位，會被立即設(shè)置成正，雖然開始事件的中斷可能更早地已經(jīng)發(fā)生。所以必須在新的中斷發(fā)生之前編程清除上一次中斷標(biāo)志。 當(dāng)中斷事件發(fā)生時，在寄存器C中相關(guān)的中斷標(biāo)志位被置成邏輯1。這些中斷標(biāo)志位被獨立的設(shè)置成與對應(yīng)的寄存器B使能位。這些標(biāo)志位在沒有設(shè)置對應(yīng)的使能位時能被用于一個輸詢模態(tài)。這些中斷標(biāo)志位是軟件運行不可少的狀態(tài)標(biāo)志位。當(dāng)有一個標(biāo)志位被設(shè)定時表有中斷事件已經(jīng)發(fā)生因為它是最后一個被讀取的數(shù)據(jù)。然而在用標(biāo)志位時要注意因為他們在每次讀完寄存器C時就會被清除

44、。寄存器C包括雙重瑣定以至設(shè)置的標(biāo)志位在讀周期保持穩(wěn)定。當(dāng)在讀和在讀周期期間發(fā)生的新中斷時候，被設(shè)定的所有位都會被清除的直到在周期被完成。一,二,或當(dāng)讀確定沒有中斷被遺失，當(dāng)每個用旗子一點點的閱讀寄存器 C. 應(yīng)該被調(diào)查的時候，三一點點能被設(shè)定。當(dāng)讀寄存器C時一、二或三個位都可以被設(shè)定。每一個位都應(yīng)該被檢查以保證不丟失中斷。 在使能位都置位的時候?qū)崿F(xiàn)標(biāo)志位的第二個用法。當(dāng)一個中斷標(biāo)志位被設(shè)置而且中斷使能位也被置位時引腳也變低。只要三個標(biāo)志位有一個標(biāo)志位以及與它相對的使能位被置位則有效。不管什么時候只要為低則在寄存器C里的P為就會被置位。是否開始一個中斷是由讀寄存器C決定的，如果F位為1則表明

45、有一個或多個中斷已經(jīng)被 DS12887 開始，讀寄存器 C 的能清除所有的正標(biāo)志位和IRQF位。 晶體震蕩器控制位 當(dāng)DS12887從廠里買出來時，它的內(nèi)部晶體震蕩器是關(guān)閉的，這樣可以阻止該器件在使用之前不消耗內(nèi)部的鋰電池。在寄存器A的4、5、6位寫上010能夠開啟晶體震蕩器和分頻器。當(dāng)寫上11X時晶體震蕩器開啟但是分頻器處于復(fù)位狀態(tài)。除了這兩種寫法外的任何一種寫法都會關(guān)閉晶體震蕩器。 方波輸出選擇 15級分頻器中的13個可以用來選擇1到15的任何一個。選擇分頻器抽頭第一個作用就是在SQW引腳上產(chǎn)生方波輸出。在寄存器A中的R0-R3用來確定方波的頻率。一旦方波被選擇則可以通過編程控制方

46、波輸出使能（SQWE）位來控制SQW引腳的開和關(guān)。 周期性中斷選擇 周期性中斷選擇能在IRQ引腳上產(chǎn)生沒500ms一次到每122s一次的中斷信號。這是從鬧鐘中斷中分離出來的一個功能，他可以輸出每秒一次到每天才到一次中斷信號。這個中斷的頻率同樣可以用寄存器A中的R0-R3來確定，改變這些位可以同時改變方波輸出的頻率和周期性中斷輸出的頻率。然而每種功能在寄存器B中都有單獨的使能位，SQWE位控制方波輸出，同樣PIE位控制周期性中斷的輸出。周期性中斷還可以用來作為軟件計數(shù)器來測量輸入,產(chǎn)生輸出間隔, 或等候下個需要的軟件功能。 更新循環(huán) DS12887不管寄存器B的SET位是什么狀態(tài)每秒都會

47、執(zhí)行一次更新周期。當(dāng)SET位為1時，雙重緩沖的時間，日歷和警報字節(jié)的副本都會被凍結(jié)并且將不會隨著時間的更新而更新。 然而，時間倒計時鏈繼續(xù)更新緩沖的內(nèi)在副本。這一個特征允許時間維持它的準(zhǔn)確性而不受讀或?qū)憰r間，日歷和警報緩沖的影響而且還保證了時間和日歷信息是一致性。更新周期也把每個警報字節(jié)與對應(yīng)的時間字節(jié)作比較而且一旦發(fā)現(xiàn)匹配或出現(xiàn)" 不關(guān)心 " 碼在所有的三個位中則發(fā)一聲警報。 有三個方法能處理RTC避免任何發(fā)生存取不一致的時間和日歷數(shù)據(jù)的可能。第一個方法使用更新結(jié)束中斷。如果中斷使能，則在每一次更新循環(huán)后都會發(fā)生中斷這個循環(huán)表明超過999ms也可以讀取有效的時間和數(shù)據(jù)信息。如果這一個中斷被

48、用, 在寄存器 C 中IRQF位應(yīng)該在離開中斷之前清除的。寄存器A中的（UIP）位的第二種用法是用來標(biāo)識更新的狀態(tài)。UIP的脈沖每秒一次，在UIP變?yōu)?后更新轉(zhuǎn)移就會在此后244s發(fā)生。如果發(fā)現(xiàn)UIP位為0則DS12887的時間或日歷數(shù)據(jù)會在至少244s才發(fā)生變化。所以用戶應(yīng)該避免中斷服務(wù)會引起需要讀有效的時間/ 日歷數(shù)據(jù)超過244s。 第三種方法使用周期性的中斷決定是否一個更新周期正在進(jìn)行之中。在寄存器C的PF位的設(shè)定期間寄存器A的 UIP位被設(shè)為1的。周期中斷發(fā)生的比率要比BUC 允許有效的時間和日期信息到達(dá)周期的中斷發(fā)生大。閱讀應(yīng)該是完全的在里面確定數(shù)據(jù)不在更新周期期間被讀的一(tPI

49、/2+ tBUC)。讀取應(yīng)該在一個(tPI/2+ tBUC)內(nèi)完成，這樣才能保證不會讓讀取發(fā)生在數(shù)據(jù)更新周期。 內(nèi)部資料 僅供參考 9JWKffwvG#tYM*Jg&6a*CZ7H$dq8KqqfHVZFedswSyXTy#&QA9wkxFyeQ^!djs#XuyUP2kNXp6X4NGpP$vSTT#UE9wEwZ#Qc@UE%&qYp@Eh5pDx2zVkum&gTXRm6X4NGpP$vSTT#&ksv*3tnGK8!z89AmYWpazadNu##KN&MuWFA5ux^Gjqv^$UE9wEwZ#Qc@UE%&qYp@Eh5pDx2zVkum&g

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