《集成計(jì)數(shù)器及寄存器的運(yùn)用實(shí)驗(yàn)報(bào)告》由會(huì)員分享，可在線閱讀，更多相關(guān)《集成計(jì)數(shù)器及寄存器的運(yùn)用實(shí)驗(yàn)報(bào)告（4頁珍藏版）》請(qǐng)?jiān)谘b配圖網(wǎng)上搜索。
1、電子通信與軟件工程 系2013-2014學(xué)年第2學(xué)期
《數(shù)字電路與邏輯設(shè)計(jì)實(shí)驗(yàn)》實(shí)驗(yàn)報(bào)告
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班級(jí)： 姓名： 學(xué)號(hào)： 成績(jī)：
同組成員： 姓名： 學(xué)號(hào)： -----------------------------------------------
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一、 實(shí)驗(yàn)名稱：集成計(jì)數(shù)器及寄存器的運(yùn)用
二、實(shí)驗(yàn)?zāi)康模?1.熟悉集成計(jì)數(shù)器邏輯功能和各控制端作用。
2.掌握計(jì)數(shù)器使用方法。
三、 實(shí)驗(yàn)內(nèi)容及步驟：
1.集成計(jì)數(shù)器74LS90功能測(cè)試。74LS90是二一五一十進(jìn)制異步計(jì)數(shù)器。邏輯簡(jiǎn)圖為圖8.1所示。
四、
五、 圖8.1
六、
74LS90具有下述功能：
直接置，直接置9（S9(1，S，．：，＝1)
二進(jìn)制計(jì)數(shù)(CP、輸入QA
3、輸出)
五進(jìn)制計(jì)數(shù)(CP2輸入QDQCQB箱出)
十進(jìn)制計(jì)數(shù)（兩種接法如圖8.2A、B所示）
按芯片引腳圖分別測(cè)試上述功能，并填入表 8.1、表8.2、表8.3中。
圖8.2 十進(jìn)制計(jì)數(shù)器
2. 計(jì)數(shù)器級(jí)連
分別用2片74LS90計(jì)數(shù)器級(jí)連成二一五混合進(jìn)制、十進(jìn)制計(jì)數(shù)器。
3. 任意進(jìn)制計(jì)數(shù)器設(shè)計(jì)方法
采用脈沖反饋法（稱復(fù)位法或置位法）?？捎?4LS90組成任意模(M)計(jì)數(shù)器。圖8.3是用74LS90實(shí)現(xiàn)模7計(jì)數(shù)器的兩種方案，圖(A)采用復(fù)位法。即計(jì)數(shù)計(jì)到M異步清0。圖（B）采用置位法，即計(jì)數(shù)計(jì)到M一1異步置0。
圖8.3 74LS90 實(shí)現(xiàn)七進(jìn)進(jìn)制計(jì)
4、數(shù)方法
（1） 按圖8.3接線，進(jìn)行驗(yàn)證。
（2） 設(shè)計(jì)一個(gè)九進(jìn)制計(jì)數(shù)器并接線驗(yàn)證。
（3） 記錄上述實(shí)驗(yàn)的同步波形圖。
四、實(shí)驗(yàn)結(jié)果：
R0（1） R0（2） S9（1） S9（2）
輸出
QD QC QB QA
H H L X
L L L L
H H X L
L L L L
X X H H
H L L H
X L X L
保持 二進(jìn)制
L X L
5、 X
保持 五進(jìn)制
L X X L
保持 8421十進(jìn)制
X L L X
保持 5421十進(jìn)制
七進(jìn)制：
計(jì)數(shù)
輸出
QD
QC
QB
QA
0
0
0
0
0
1
0
0
0
1
2
0
0
1
0
3
0
0
1
1
4
0
1
0
0
5
0
1
0
1
6
1
0
0
1
7
0
0
0
0
復(fù)位法
6、 置位法
計(jì)數(shù)
輸出
QD
QC
QB
QA
0
0
0
0
0
1
0
0
0
1
2
0
0
1
0
3
0
0
1
1
4
0
1
0
0
5
0
1
0
1
6
0
1
1
0
7
0
0
0
0
九進(jìn)制
計(jì)數(shù)
輸出
QD
QC
QB
QA
0
0
0
0
0
1
0
0
0
1
2
0
0
1
0
3
0
0
1
1
4
0
1
0
0
5
7、0
1
0
1
6
0
1
1
0
7
0
1
1
1
8
1
0
0
0
9
0
0
0
0
五、實(shí)驗(yàn)總結(jié)
計(jì)數(shù)器使用廣泛，不僅可以對(duì)脈沖進(jìn)行計(jì)數(shù)，還可以用于分頻、定時(shí)、產(chǎn)生節(jié)拍脈沖以及其他時(shí)序信號(hào)。通過反饋清零法或是反饋置數(shù)法還可以用現(xiàn)有的計(jì)數(shù)器方便構(gòu)造出其他進(jìn)制計(jì)數(shù)器。此次實(shí)驗(yàn)在接線過程中出現(xiàn)了許多失誤導(dǎo)致，實(shí)驗(yàn)最終剛得出結(jié)論用了許多的時(shí)間，在排錯(cuò)的過程中會(huì)出現(xiàn)不耐煩的情況，做實(shí)驗(yàn)不僅也是對(duì)學(xué)術(shù)上知識(shí)的鞏固和鍛煉實(shí)操，也是對(duì)人心態(tài)的磨合，后來排除錯(cuò)誤之后才發(fā)現(xiàn)如果先前靜下心，再耐心點(diǎn)，問題會(huì)更快得到解決，實(shí)驗(yàn)研究也是需要鍛煉一顆能沉靜下來做事的心。
集成計(jì)數(shù)器及寄存器的運(yùn)用實(shí)驗(yàn)報(bào)告
